為幫助大家備考軟考中級(jí)軟件設(shè)計(jì)師考試，希賽小編整理了2022下半年軟件設(shè)計(jì)師考試知識(shí)點(diǎn)100條（1），希望對(duì)大家備考有幫助。

1、碼制的表示

定點(diǎn)整數(shù)

原碼與反碼的0既有+0也有-0，數(shù)碼的表示個(gè)數(shù)為2n-1個(gè)。補(bǔ)碼與移碼有人為定義，-0編碼定義為最小數(shù)值-1，數(shù)碼的表示個(gè)數(shù)為2n個(gè)，最小表示數(shù)值為2n-1。

定點(diǎn)小數(shù)

數(shù)碼的表示個(gè)數(shù)與定點(diǎn)整數(shù)一致。補(bǔ)碼與移碼的人為定義，將-0的編碼定義為最小數(shù)值-1。

2、浮點(diǎn)數(shù)的表示

浮點(diǎn)數(shù)格式

階碼決定范圍，階碼越長(zhǎng)，范圍越大；

尾數(shù)決定精度，尾數(shù)越長(zhǎng)，精度越高。

浮點(diǎn)數(shù)運(yùn)算過(guò)程

對(duì)階→尾數(shù)計(jì)算→格式化；

對(duì)階：小數(shù)像大數(shù)看齊，尾數(shù)右移。

3、校驗(yàn)碼

4、CPU組成

CPU分為運(yùn)算器與控制器兩大部分。

運(yùn)算器

算術(shù)邏輯單元ALU：執(zhí)行算術(shù)運(yùn)算和邏輯運(yùn)算。

累加寄存器AC：暫存數(shù)據(jù)，為ALU提供工作區(qū)。

數(shù)據(jù)緩沖寄存器DR

狀態(tài)條件寄存器PSW歸屬有爭(zhēng)議

控制器

指令計(jì)數(shù)器PC：存儲(chǔ)下一條要執(zhí)行指令的地址

指令寄存器IR：存儲(chǔ)即將執(zhí)行的指令

指令譯碼器ID

時(shí)序部件

5、CISC與RISC

CISC（復(fù)雜指令集）的特點(diǎn)：指令數(shù)量多，指令頻率差別大，變長(zhǎng)，多種尋址方式，使用微碼（微程序）實(shí)現(xiàn)。

RISC（精簡(jiǎn)指令集）的特點(diǎn)：指令數(shù)量少，頻率接近，定長(zhǎng)，單周期，多寄存器尋址，多通用寄存器，硬布線邏輯控制，適用于流水線。有效支持高級(jí)程序語(yǔ)言，優(yōu)化編譯。

6、流水線技術(shù)

流水線建立時(shí)間：第1條指令執(zhí)行時(shí)間

流水線周期：指令分段后，最長(zhǎng)段時(shí)間

流水線執(zhí)行時(shí)間（默認(rèn)使用理論公式，無(wú)答案時(shí)考慮實(shí)踐公式）

理論公式：流水線建立時(shí)間+（指令條數(shù)-1）*流水線周期

實(shí)踐公式：指令段數(shù)*流水線周期+（指令條數(shù)-1）*流水線周期

吞吐率=指令條數(shù)/流水線執(zhí)行時(shí)間

最大吞吐率=流水線周期的倒數(shù)。

7、局部性原理

時(shí)間局部性：指程序中的某條指令一旦執(zhí)行，不久以后該指令可能再次執(zhí)行，典型原因是由于程序中存在著大量的循環(huán)操作。

空間局部性：指一旦程序訪問(wèn)了某個(gè)存儲(chǔ)單元，不久以后，其附近的存儲(chǔ)單元也將被訪問(wèn)，即程序在一段時(shí)間內(nèi)所訪問(wèn)的地址可能集中在一定的范圍內(nèi)，其典型情況是程序順序執(zhí)行。

8、常見(jiàn)存儲(chǔ)器

按內(nèi)容存取

相聯(lián)存儲(chǔ)器（如Cache）

按地址存取

隨機(jī)存取存儲(chǔ)器（如內(nèi)存）

順序存取存儲(chǔ)器（如磁帶）

直接存取存儲(chǔ)器（如磁盤）

工作方式

隨機(jī)存取存儲(chǔ)器RAM（如內(nèi)存DRAM）

只讀存儲(chǔ)器ROM（如BIOS）

9、Cache

在計(jì)算機(jī)的存儲(chǔ)系統(tǒng)體系中，Cache是（除寄存器以外）訪問(wèn)速度最快的層次。解決CPU與主存之間速度容量不匹配問(wèn)題。

Cache與主存映射三種方式：

10、主存編址計(jì)算

內(nèi)存單元數(shù)個(gè)數(shù)=最大地址+1-最小地址

內(nèi)存編址內(nèi)容：

按字編址（每個(gè)存儲(chǔ)單元存放內(nèi)容為機(jī)器字長(zhǎng)—題干定義）

按字節(jié)編址（每個(gè)存儲(chǔ)單元內(nèi)容為1字節(jié)即8bit）

內(nèi)存總?cè)萘?內(nèi)存單元數(shù)*編址內(nèi)容

總?cè)萘?單位芯片容量*總片數(shù)

總片數(shù)=總?cè)萘?單位容量；

單位芯片容量=總?cè)萘?芯片片數(shù)。